VHDL-FPGA-Verilog List Page 4306

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移位寄存器 Downloaded：1: First in first out寄存器的verilog源代码
Update : 2009-02-22 Size : 1.14kb Publisher : sh0205
电梯控制器程序设计与仿真 Downloaded：1: 电梯控制器程序设计与仿真,已经通过仿真．
Update : 2009-02-24 Size : 158.71kb Publisher : zhangjie5168
100Examples Downloaded：0: 100个VHDL语言示例源代码
Update : 2009-03-06 Size : 203.71kb Publisher : baoyatu
密勒解码器 Downloaded：0: 本题的程序参考了 wangliwei同学的设计文档，在此非常感谢他给我学习的机会。好在我自己是抱着学习的态度来参加这次大赛的，所以也不至于说成抄袭:(. 本文在理解wangliwei同学程序的基础上，改写了“检测模块”，重新编写了“解码模块”以及三个测试程序。所以这次虽然交的很晚，但总算是我自己理解的成果，我学到了知识，这就够了。关于本次程序的一点理解： (1) 由于给定时钟不完整，“检测模块”中大量使用了“事件触发”，这对综合后的结
Update : 2009-03-18 Size : 207.45kb Publisher : qwzhenga@gmail.com
8bit全加器带进位复位功能 Downloaded：0: 8bit全加器带进位复位功能已经通过防真
Update : 2009-03-20 Size : 320byte Publisher : pslinhu1@126.com
5分频、移相VHDL程序 Downloaded：4: 有两端VHDL程序，5分频的和分频移相的，希望大家用的上
Update : 2009-03-23 Size : 1kb Publisher : chenzj.cash@163.com
FFT的FPGA实现 Downloaded：2: 快速傅里叶变换的FPGA实现
Update : 2009-03-23 Size : 13.88mb Publisher : 471512024@qq.com
SDRAM控制核 Downloaded：0: SDRAM控制核SDRAM控制核
Update : 2009-03-26 Size : 98.49kb Publisher : sunrainhh
基于CPLD的VHDL语言数字钟（含秒表）设计 Downloaded：0: 基于CPLD的VHDL语言数字钟（含秒表）设计
Update : 2009-03-30 Size : 113.5kb Publisher : gaojianlin19880605@163.com
VHDL编写的walsh码产生程序 Downloaded：2: VHDL语言编写的产生walsh码程序.
Update : 2009-04-01 Size : 902byte Publisher : lipengsir_1@yahoo.com.cn
多功能波形发生器VHDL程序与仿真 Downloaded：0: 非常实用的一款软件,多功能波形发生器VHDL程序与仿真
Update : 2009-04-03 Size : 60.5kb Publisher : yuan0425
汉明纠错码译码器源程序 Downloaded：1: 汉明纠错码译码器的VHDL源程序
Update : 2009-04-03 Size : 3.26kb Publisher : yxpsc@tom.com

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